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Cadence电路图设计百例目录

2022/07/16105 作者:佚名
导读:第1章创建原理图 例1—1 新建一个设计项目 例1—2 打开一个设计项目 例1—3 设置一个设计项目 例1—4 Design Entry HDL的画面操作 例1—5 Design Entry HDL的显示 例1—6 Design Entry HDL应用Ssroke 例1—7 Design Entry HDL群组(Group) 例2-1 添加元器件 14 例2-2 删除元器件 15 例2-3 调整元

第1章创建原理图

例1—1 新建一个设计项目

例1—2 打开一个设计项目

例1—3 设置一个设计项目

例1—4 Design Entry HDL的画面操作

例1—5 Design Entry HDL的显示

例1—6 Design Entry HDL应用Ssroke

例1—7 Design Entry HDL群组(Group)

例2-1 添加元器件 14

例2-2 删除元器件 15

例2-3 调整元器件 16

例2-4 添加元器件属性 19

例2-5 进入原理图库 20

例2-6 进入Part Developer 21

例2-7 设置Part Developer 22

第3章 原理图绘制 25

例3-1 设置原理图格点图框 25

例3-2 连接导线 27

例3-3 元件位号标注 28

例3-4 添加输入/输出端口 29

例3-5 添加电源、接地符号和线路节点 30

例3-6 检查原理图 31

第4章 原理图文件的输入 33

例4-1 原理图生成模块符号 33

例4-2 原理图打包 34

例4-3 料单的生成和输出设置 36

例4-4 电子规则检测设置 37

例4-5 网表报告的生成 38

例4-6 原理图打印设置 39

例4-7 保存PDF文件设置 40

例4-8 原理图文件归档 40

例4-9 导入网表文件 41

例4-10 Allegro PCB系统参数设定 43

例4-11 Allegro PCB视图设置 47

例4-12 Allegro PCB信息的显示 50

第5章 创建元器件 52

例5-1 新元件的创建 52

例5-2 封装的创建 53

例5-3 逻辑管脚的添加 55

例5-4 管脚图的指定 57

例5-5 电源管脚的处理 59

例5-6 管脚的映射 60

例5-7 符号的创建 63

例5-8 校验元件 65

例5-9 用PDF文档创建元件 66

例5-10 创建复合封装的元件 71

例5-11 创建不对称封装的元件 73

例5-12 逻辑管脚的修改 79

例5-13 封装的修改 84

例5-14 符号的修改 88

例5-15 启动元件列表编辑器并创建列表文件 90

例5-16 修改元件列表 92

例5-17 元件模板的创建 95

例5-18 元件模板的调用 97

例5-19 根据模板校验元件 97

例5-20 从元件中提取模板 98

例5-21 贴片焊盘的制作 100

例5-22 通孔焊盘的制作 102

例5-23 盲孔焊盘的制作 105

例5-24 埋孔焊盘的制作 107

例5-25 如何进入Allegro Package封装编辑器 109

例5-26 创建Flash符号 110

例5-27 创建Format符号 111

例5-28 创建一个Shape符号 113

例5-29 创建PCB外形框图符号 114

第6章 PCB基础 119

例6-1 进入Allegro PCB Design GXL界面 119

例6-2 定义和运行脚本 120

例6-3 元器件信息显示 122

例6-4 使用电路板向导建立板框 124

例6-5 手工建立板框 127

例6-6 建立电路板机械符号 131

例6-7 建立DEMO文件 138

第7章 PCB布局及布线 144

例7-1 添加ROOM 144

例7-2 手工摆放元件 145

例7-3 快速摆放元件 147

例7-4 添加连线 148

例7-5 走线的删除 149

例7-6 添加过孔 150

例7-7 使用Auto Router自动布线 151

第8章 Allegro PCB的覆铜 154

例8-1 为平面层建立Shape 154

例8-2 使用Anti Etch分割平面 158

例8-3 建立动态Shape 160

例8-4 改变Shape的类型 163

例8-5 编辑边界并添加Trace 164

例8-6 定义复杂平面 165

例8-7 添加负平面Shape并进行负平面孤铜检查 167

第9章 Allegro PCB输出 171

例9-1 自动添加测试点 171

例9-2 修改测试点 173

例9-3 自动重命名元件序号 176

例9-4 手动重命名元器件 178

例9-5 文字层的调整 179

例9-6 设计检查 181

例9-7 底片文件的输出 183

例9-8 钻孔文件 186

例9-9 生成器件清单 190

第10章 Allegro PCB高级应用 192

例10-1 显示飞线 192

例10-2 功能交换 193

例10-3 管脚交换 196

例10-4 元件的交换 197

例10-5 自动交换 198

例10-6 用Quickplace进行布局 199

例10-7 使用ALT_SYMBOL属性摆放 201

例10-8 原理图与Allegro的交互选择 203

例10-9 原理图和Allegro交互高亮和反高亮元件 204

例10-10 原理图和Allegro交互高亮和反高亮网络 207

例10-11 自动布局 209

例10-12 扇出布线 213

例10-13 群组布线 216

例10-14 蛇形走线 218

例10-15 使用Bubble选项布线 222

例10-16 差分对布线 223

例10-17 高速网络布线 229

例10-18 45度角调整 231

例10-19 检查未连接的管脚 233

例10-20 改善连接 234

例10-21 编辑拐角 236

例10-22 替换走线 237

例10-23 使用Cut选项修改线 238

例10-24 固定关键网络和Gloss参数设置 240

例10-25 添加和删除泪滴 242

例10-26 自定义平滑走线 243

例10-27 进入约束管理器用户界面 245

例10-28 约束对象——管脚对 248

例10-29 约束对象——总线 250

例10-30 设置设计约束 251

例10-31 为元件添加基本属性 253

例10-32 为元器件添加Room属性 255

参考文献 257

*文章为作者独立观点,不代表造价通立场,除来源是“造价通”外。
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