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多路选择器2选1

2022/07/18111 作者：佚名
导读：EDA和VHDL代码 library ieee use ieee.std_logic_1164.all; entity data is port(in0,in1,se1:in std_logic; output:out std_logic); architecture one of data is begin output<=in0 when se1='0'else in1; end archit

EDA和VHDL代码

library ieee

use ieee.std_logic_1164.all;

entity data is

port(in0,in1,se1:in std_logic;

output:out std_logic);

architecture one of data is

begin

output<=in0 when se1='0'else in1;

end architecture one;

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